30Gsps 6bit DAC的芯片面積為3mm x 2.8mm，采用了分段式電流舵DAC架構(gòu)。該芯片集成24路高速串行數(shù)據(jù)接收器，以及4-1MUX高速電路，支持在30GSps采樣率下全速率輸出。該芯片還集成了占空比校正和延遲偏差校準(zhǔn)電路。測(cè)試結(jié)果表明芯片在30Gsps 采樣率下工作時(shí)，低頻無雜散動(dòng)態(tài)范圍(SFDR)達(dá)到44dBc，在第一奈奎斯特區(qū)內(nèi)SFDR大于28.5dBc。芯片總功耗6.2W。
圖1. 30Gsps 6bit ADC的實(shí)物照片和高頻測(cè)試結(jié)果
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